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MAX13171E/MAX13173E/MAX13175E

Multiprotocol, Pin-Selectable

Data Interface Chipset

20 ______________________________________________________________________________________

Timing Diagrams

90%

10%

50%

PLH

-V

TIN_

B - A

PHL

90%

10%

50%

f = 1MHz: t

, t

≤ 1ns

Figure 6. V.11 Transmitter Propagation Delays

+1V

-1V

B - A

INPUT

OUTPUT

PLH

PHL

f = 1MHz: t

, t

≤ 1ns

90%

10%

90%

10%

Figure 7. V.11 Receiver Propagation Delays

PHL

-V

TIN_

10%

90%

PLH

90%

10%

, t

≤ 10ns

/2 V

Figure 8. V.10 Transmitter Propagation Delay

PHL

PLH

, t

≤ 10ns

90%

10%

90%

10%

Figure 9. V.10 Receiver Propagation Delay

1 2 ... 15 16 17 18 19 20 21 22 23 24 25 ... 37 38

MAX13171E/MAX13173E/MAX13175E 1
Data Interface Chipset 1

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