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MAX9217

27-Bit, 3MHz-to-35MHz

DC-Balanced LVDS Serializer

6 _______________________________________________________________________________________

Functional Diagram

MAX9217

TIMING AND CONTROL

DC BALANCE/

ENCODE

INPUT LATCH

RGB_IN

CNTL_IN

DE_IN

PCLK_IN

RNG0

RNG1

PWRDWN

OUT+

OUT-

CMF

MOD0

MOD1

PLL

PAR-TO-SER

OUT-

GND

/ 2

OUT+

OUT-

OUT+

(OUT+) - (OUT-)

(-) V

(+)

((OUT+) + (OUT-)) / 2

(-)

= 0V

∆V

= |V

(+) - V

(-)|

∆V

= |V

(+) - V

(-)|

(+)

Figure 1. LVDS DC Output Load and Parameters

1 2 3 4 5 6 7 8 9 10 11 ... 15 16

27-Bit, 3MHz-to-35MHz 1
DC-Balanced LVDS Serializer 1
48L THIN QFN.EPS 16

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