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W90P710CD/W90P710CDG

Publication Release Date: September 19, 2006

- 77 - Revision B2

31 30 29 28 27 26 25 24

RESERVED

23 22 21 20 19 18 17 16

RESERVED

15 14 13 12 11 10 9 8

RESERVED tRCD

7 6 5 4 3 2 1 0

tRDL tRP tRAS

BITS DESCRIPTION

[31:11] RESERVED -

[10:8] tRCD

SDRAM bank 0/1, /RAS to /CAS delay

tRCD [10:8] MCLK

0 0 0 1

0 0 1 2

0 1 0 3

0 1 1 4

1 0 0 5

1 0 1 6

1 1 0 7

1 1 1 8

[7:6] tRDL

SDRAM bank 0/1, Last data in to pre-charge command

tRDL [7:6] MCLK

0 0 1

0 1 2

1 0 3

1 1 4

[5:3] tRP

SDRAM bank 0/1, Row pre-charge time

tRP [5:3] MCLK

0 0 0 1

0 0 1 2

0 1 0 3

0 1 1 4

1 0 0 5

1 0 1 6

1 1 0 7

1 1 1 8

1 2 ... 72 73 74 75 76 77 78 79 80 81 82 ... 551 552

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